代码人生的小狗窝

一行行枯燥的代码,却描绘出人生的点点滴滴

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作者:coody分类:【_硬件开发浏览(1065

2018-05-23

一个vhdl小程序里提示两个error,看不出原因,求教各位前辈,多谢了

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作者:coody分类:【_硬件开发浏览(1941

2018-05-24

VHDL中的port 地图用后,仿真管脚不是想要的效果

    VHDL中的port map用后,仿真管脚不是想要的效果?library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity bisou is port(a:in std_logic; b:in std_logic; y1:out std_logic); end bisou; architecture bisou of bisou is signal u:std_logic_vector(1 downto 0); begin u(0)<=a; u(1)<=b; y1<='1' when&nb

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作者:coody分类:【_硬件开发浏览(1029

2018-05-23

请问:在EMC中使用铁壳的屏蔽RJ45时,网线的屏蔽层如何避免

    请教:在EMC中使用铁壳的屏蔽RJ45时,网线的屏蔽层如何处理?在电磁兼容实验中,耦合夹给网线加快速瞬变干扰时会把通信出现问题,所以改进设计时使用了带触角的Rj45,并打算使用金属水晶头和双屏蔽网线。但是关于双屏蔽网线的铝箔层和铜网层以及中心的铜线如何处理一头雾水,网上查资料说中心的铜线要绕在铜网上然后按在金属水晶头里和金属接触上,但是关于铝箔处理和其他的一些细节还是不太清楚,请大家帮忙指点一下,谢谢------解决方案--------------------你说的双层屏蔽就是一层编织网和一层铝箔层吧?这是6类屏蔽线。(7类的每对双绞线都有单独的屏蔽层) 铝箔层朝向双绞线的那一面有绝缘,这个不必考虑。朝外的那一面无绝缘层,正常情况下这一面与编织网是导电良好的。 此外还有一根较粗的单根镀锡铜线,这根铜线就是要连接到水晶头的屏蔽壳上的。 编织网和铝箔层长度一致就可以(一起切掉),不必考虑。-

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作者:coody分类:【_硬件开发浏览(728

2018-05-23

一个VHDL小疑点

    一个VHDL小问题在VHDL中,时钟信号可以用clk'event and clk='1' 来描述其上升沿,那其他的非时钟信号怎么表述呢? 还有一个进程process里面可不可以捕捉多个信号的上升沿?------解决方案--------------------A1:上升沿、下降沿、电平都只是触发方式的描述,不仅仅针对时钟信号,其他信号也可以。 signal'event and signal='1' 或rising_edge(signal)都是描述信号的上升沿触发。 A2:VHDL支持多沿触发,但有限制条件   1.不可在同一条if语句中描述两个及以上的边沿触发      如 if ( rising_edge(signal1)&nbs

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2018-05-24

有何位大神弄过DPS和DS1307时钟芯片

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2018-05-20

数组跟指针的区别

    数组和指针的区别本帖最后由 yykebeibei 于 2014-09-18 23:03:08 编辑   以下函数的功能是,遍历输入的字符串,去掉空格后输出 #include <stdio.h> #include <string.h>  int main(void){ char input[100]; static int i; printf("input string\n"); gets(input); for(i = 0; i<strlen(input); i++){   if(input[i] == ' 

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2018-05-22

mega8驱动ssd1306(OLED)遇到有关问题

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2018-05-21

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2018-05-22

USB2.0学习笔记连载(6):USB2.0硬件设计需要注意事项

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2018-05-25

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2018-05-21

关于AD9516芯片的硬件设计跟FPGA程序编写心得

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2018-05-22

微信智能硬件开发的了解

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2018-05-24
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